dt-bindings: cpufreq: cpufreq-qcom-hw: Convert to YAML bindings
Convert Qualcomm cpufreq devicetree binding to YAML. Signed-off-by: Manivannan Sadhasivam <manivannan.sadhasivam@linaro.org> Signed-off-by: AngeloGioacchino Del Regno <angelogioacchino.delregno@somainline.org> Reviewed-by: Rob Herring <robh@kernel.org> Reviewed-by: Krzysztof Kozlowski <krzysztof.kozlowski@canonical.com> Signed-off-by: Viresh Kumar <viresh.kumar@linaro.org>
This commit is contained in:
Manivannan Sadhasivam
Viresh Kumar
Родитель
cac2ed0a1b
Коммит
b7f2b0d351
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@ -1,172 +0,0 @@
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Qualcomm Technologies, Inc. CPUFREQ Bindings
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CPUFREQ HW is a hardware engine used by some Qualcomm Technologies, Inc. (QTI)
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SoCs to manage frequency in hardware. It is capable of controlling frequency
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for multiple clusters.
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||||||
Properties:
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||||||
- compatible
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||||||
Usage: required
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||||||
Value type: <string>
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||||||
Definition: must be "qcom,cpufreq-hw" or "qcom,cpufreq-epss".
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||||||
- clocks
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||||||
Usage: required
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||||||
Value type: <phandle> From common clock binding.
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||||||
Definition: clock handle for XO clock and GPLL0 clock.
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- clock-names
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||||||
Usage: required
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||||||
Value type: <string> From common clock binding.
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||||||
Definition: must be "xo", "alternate".
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||||||
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||||||
- reg
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||||||
Usage: required
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||||||
Value type: <prop-encoded-array>
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||||||
Definition: Addresses and sizes for the memory of the HW bases in
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||||||
each frequency domain.
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||||||
- reg-names
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||||||
Usage: Optional
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||||||
Value type: <string>
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||||||
Definition: Frequency domain name i.e.
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||||||
"freq-domain0", "freq-domain1".
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||||||
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||||||
- #freq-domain-cells:
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||||||
Usage: required.
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||||||
Definition: Number of cells in a freqency domain specifier.
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||||||
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||||||
* Property qcom,freq-domain
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||||||
Devices supporting freq-domain must set their "qcom,freq-domain" property with
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||||||
phandle to a cpufreq_hw followed by the Domain ID(0/1) in the CPU DT node.
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||||||
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||||||
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||||||
Example:
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Example 1: Dual-cluster, Quad-core per cluster. CPUs within a cluster switch
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DCVS state together.
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/ {
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cpus {
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#address-cells = <2>;
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||||||
#size-cells = <0>;
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||||||
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||||||
CPU0: cpu@0 {
|
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||||||
device_type = "cpu";
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||||||
compatible = "qcom,kryo385";
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|
||||||
reg = <0x0 0x0>;
|
|
||||||
enable-method = "psci";
|
|
||||||
next-level-cache = <&L2_0>;
|
|
||||||
qcom,freq-domain = <&cpufreq_hw 0>;
|
|
||||||
L2_0: l2-cache {
|
|
||||||
compatible = "cache";
|
|
||||||
next-level-cache = <&L3_0>;
|
|
||||||
L3_0: l3-cache {
|
|
||||||
compatible = "cache";
|
|
||||||
};
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
CPU1: cpu@100 {
|
|
||||||
device_type = "cpu";
|
|
||||||
compatible = "qcom,kryo385";
|
|
||||||
reg = <0x0 0x100>;
|
|
||||||
enable-method = "psci";
|
|
||||||
next-level-cache = <&L2_100>;
|
|
||||||
qcom,freq-domain = <&cpufreq_hw 0>;
|
|
||||||
L2_100: l2-cache {
|
|
||||||
compatible = "cache";
|
|
||||||
next-level-cache = <&L3_0>;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
CPU2: cpu@200 {
|
|
||||||
device_type = "cpu";
|
|
||||||
compatible = "qcom,kryo385";
|
|
||||||
reg = <0x0 0x200>;
|
|
||||||
enable-method = "psci";
|
|
||||||
next-level-cache = <&L2_200>;
|
|
||||||
qcom,freq-domain = <&cpufreq_hw 0>;
|
|
||||||
L2_200: l2-cache {
|
|
||||||
compatible = "cache";
|
|
||||||
next-level-cache = <&L3_0>;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
CPU3: cpu@300 {
|
|
||||||
device_type = "cpu";
|
|
||||||
compatible = "qcom,kryo385";
|
|
||||||
reg = <0x0 0x300>;
|
|
||||||
enable-method = "psci";
|
|
||||||
next-level-cache = <&L2_300>;
|
|
||||||
qcom,freq-domain = <&cpufreq_hw 0>;
|
|
||||||
L2_300: l2-cache {
|
|
||||||
compatible = "cache";
|
|
||||||
next-level-cache = <&L3_0>;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
CPU4: cpu@400 {
|
|
||||||
device_type = "cpu";
|
|
||||||
compatible = "qcom,kryo385";
|
|
||||||
reg = <0x0 0x400>;
|
|
||||||
enable-method = "psci";
|
|
||||||
next-level-cache = <&L2_400>;
|
|
||||||
qcom,freq-domain = <&cpufreq_hw 1>;
|
|
||||||
L2_400: l2-cache {
|
|
||||||
compatible = "cache";
|
|
||||||
next-level-cache = <&L3_0>;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
CPU5: cpu@500 {
|
|
||||||
device_type = "cpu";
|
|
||||||
compatible = "qcom,kryo385";
|
|
||||||
reg = <0x0 0x500>;
|
|
||||||
enable-method = "psci";
|
|
||||||
next-level-cache = <&L2_500>;
|
|
||||||
qcom,freq-domain = <&cpufreq_hw 1>;
|
|
||||||
L2_500: l2-cache {
|
|
||||||
compatible = "cache";
|
|
||||||
next-level-cache = <&L3_0>;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
CPU6: cpu@600 {
|
|
||||||
device_type = "cpu";
|
|
||||||
compatible = "qcom,kryo385";
|
|
||||||
reg = <0x0 0x600>;
|
|
||||||
enable-method = "psci";
|
|
||||||
next-level-cache = <&L2_600>;
|
|
||||||
qcom,freq-domain = <&cpufreq_hw 1>;
|
|
||||||
L2_600: l2-cache {
|
|
||||||
compatible = "cache";
|
|
||||||
next-level-cache = <&L3_0>;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
CPU7: cpu@700 {
|
|
||||||
device_type = "cpu";
|
|
||||||
compatible = "qcom,kryo385";
|
|
||||||
reg = <0x0 0x700>;
|
|
||||||
enable-method = "psci";
|
|
||||||
next-level-cache = <&L2_700>;
|
|
||||||
qcom,freq-domain = <&cpufreq_hw 1>;
|
|
||||||
L2_700: l2-cache {
|
|
||||||
compatible = "cache";
|
|
||||||
next-level-cache = <&L3_0>;
|
|
||||||
};
|
|
||||||
};
|
|
||||||
};
|
|
||||||
|
|
||||||
soc {
|
|
||||||
cpufreq_hw: cpufreq@17d43000 {
|
|
||||||
compatible = "qcom,cpufreq-hw";
|
|
||||||
reg = <0x17d43000 0x1400>, <0x17d45800 0x1400>;
|
|
||||||
reg-names = "freq-domain0", "freq-domain1";
|
|
||||||
|
|
||||||
clocks = <&rpmhcc RPMH_CXO_CLK>, <&gcc GPLL0>;
|
|
||||||
clock-names = "xo", "alternate";
|
|
||||||
|
|
||||||
#freq-domain-cells = <1>;
|
|
||||||
};
|
|
||||||
}
|
|
||||||
|
|
@ -0,0 +1,201 @@
|
||||||
|
# SPDX-License-Identifier: GPL-2.0-only OR BSD-2-Clause
|
||||||
|
%YAML 1.2
|
||||||
|
---
|
||||||
|
$id: http://devicetree.org/schemas/cpufreq/cpufreq-qcom-hw.yaml#
|
||||||
|
$schema: http://devicetree.org/meta-schemas/core.yaml#
|
||||||
|
|
||||||
|
title: Qualcomm Technologies, Inc. CPUFREQ
|
||||||
|
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|
maintainers:
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||||||
|
- Manivannan Sadhasivam <manivannan.sadhasivam@linaro.org>
|
||||||
|
|
||||||
|
description: |
|
||||||
|
|
||||||
|
CPUFREQ HW is a hardware engine used by some Qualcomm Technologies, Inc. (QTI)
|
||||||
|
SoCs to manage frequency in hardware. It is capable of controlling frequency
|
||||||
|
for multiple clusters.
|
||||||
|
|
||||||
|
properties:
|
||||||
|
compatible:
|
||||||
|
oneOf:
|
||||||
|
- description: v1 of CPUFREQ HW
|
||||||
|
items:
|
||||||
|
- const: qcom,cpufreq-hw
|
||||||
|
|
||||||
|
- description: v2 of CPUFREQ HW (EPSS)
|
||||||
|
items:
|
||||||
|
- enum:
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||||||
|
- qcom,sm8250-cpufreq-epss
|
||||||
|
- const: qcom,cpufreq-epss
|
||||||
|
|
||||||
|
reg:
|
||||||
|
minItems: 2
|
||||||
|
items:
|
||||||
|
- description: Frequency domain 0 register region
|
||||||
|
- description: Frequency domain 1 register region
|
||||||
|
- description: Frequency domain 2 register region
|
||||||
|
|
||||||
|
reg-names:
|
||||||
|
minItems: 2
|
||||||
|
items:
|
||||||
|
- const: freq-domain0
|
||||||
|
- const: freq-domain1
|
||||||
|
- const: freq-domain2
|
||||||
|
|
||||||
|
clocks:
|
||||||
|
items:
|
||||||
|
- description: XO Clock
|
||||||
|
- description: GPLL0 Clock
|
||||||
|
|
||||||
|
clock-names:
|
||||||
|
items:
|
||||||
|
- const: xo
|
||||||
|
- const: alternate
|
||||||
|
|
||||||
|
'#freq-domain-cells':
|
||||||
|
const: 1
|
||||||
|
|
||||||
|
required:
|
||||||
|
- compatible
|
||||||
|
- reg
|
||||||
|
- clocks
|
||||||
|
- clock-names
|
||||||
|
- '#freq-domain-cells'
|
||||||
|
|
||||||
|
additionalProperties: false
|
||||||
|
|
||||||
|
examples:
|
||||||
|
- |
|
||||||
|
#include <dt-bindings/clock/qcom,gcc-sdm845.h>
|
||||||
|
#include <dt-bindings/clock/qcom,rpmh.h>
|
||||||
|
|
||||||
|
// Example 1: Dual-cluster, Quad-core per cluster. CPUs within a cluster
|
||||||
|
// switch DCVS state together.
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||||||
|
cpus {
|
||||||
|
#address-cells = <2>;
|
||||||
|
#size-cells = <0>;
|
||||||
|
|
||||||
|
CPU0: cpu@0 {
|
||||||
|
device_type = "cpu";
|
||||||
|
compatible = "qcom,kryo385";
|
||||||
|
reg = <0x0 0x0>;
|
||||||
|
enable-method = "psci";
|
||||||
|
next-level-cache = <&L2_0>;
|
||||||
|
qcom,freq-domain = <&cpufreq_hw 0>;
|
||||||
|
L2_0: l2-cache {
|
||||||
|
compatible = "cache";
|
||||||
|
next-level-cache = <&L3_0>;
|
||||||
|
L3_0: l3-cache {
|
||||||
|
compatible = "cache";
|
||||||
|
};
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
CPU1: cpu@100 {
|
||||||
|
device_type = "cpu";
|
||||||
|
compatible = "qcom,kryo385";
|
||||||
|
reg = <0x0 0x100>;
|
||||||
|
enable-method = "psci";
|
||||||
|
next-level-cache = <&L2_100>;
|
||||||
|
qcom,freq-domain = <&cpufreq_hw 0>;
|
||||||
|
L2_100: l2-cache {
|
||||||
|
compatible = "cache";
|
||||||
|
next-level-cache = <&L3_0>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
CPU2: cpu@200 {
|
||||||
|
device_type = "cpu";
|
||||||
|
compatible = "qcom,kryo385";
|
||||||
|
reg = <0x0 0x200>;
|
||||||
|
enable-method = "psci";
|
||||||
|
next-level-cache = <&L2_200>;
|
||||||
|
qcom,freq-domain = <&cpufreq_hw 0>;
|
||||||
|
L2_200: l2-cache {
|
||||||
|
compatible = "cache";
|
||||||
|
next-level-cache = <&L3_0>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
CPU3: cpu@300 {
|
||||||
|
device_type = "cpu";
|
||||||
|
compatible = "qcom,kryo385";
|
||||||
|
reg = <0x0 0x300>;
|
||||||
|
enable-method = "psci";
|
||||||
|
next-level-cache = <&L2_300>;
|
||||||
|
qcom,freq-domain = <&cpufreq_hw 0>;
|
||||||
|
L2_300: l2-cache {
|
||||||
|
compatible = "cache";
|
||||||
|
next-level-cache = <&L3_0>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
CPU4: cpu@400 {
|
||||||
|
device_type = "cpu";
|
||||||
|
compatible = "qcom,kryo385";
|
||||||
|
reg = <0x0 0x400>;
|
||||||
|
enable-method = "psci";
|
||||||
|
next-level-cache = <&L2_400>;
|
||||||
|
qcom,freq-domain = <&cpufreq_hw 1>;
|
||||||
|
L2_400: l2-cache {
|
||||||
|
compatible = "cache";
|
||||||
|
next-level-cache = <&L3_0>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
CPU5: cpu@500 {
|
||||||
|
device_type = "cpu";
|
||||||
|
compatible = "qcom,kryo385";
|
||||||
|
reg = <0x0 0x500>;
|
||||||
|
enable-method = "psci";
|
||||||
|
next-level-cache = <&L2_500>;
|
||||||
|
qcom,freq-domain = <&cpufreq_hw 1>;
|
||||||
|
L2_500: l2-cache {
|
||||||
|
compatible = "cache";
|
||||||
|
next-level-cache = <&L3_0>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
CPU6: cpu@600 {
|
||||||
|
device_type = "cpu";
|
||||||
|
compatible = "qcom,kryo385";
|
||||||
|
reg = <0x0 0x600>;
|
||||||
|
enable-method = "psci";
|
||||||
|
next-level-cache = <&L2_600>;
|
||||||
|
qcom,freq-domain = <&cpufreq_hw 1>;
|
||||||
|
L2_600: l2-cache {
|
||||||
|
compatible = "cache";
|
||||||
|
next-level-cache = <&L3_0>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
CPU7: cpu@700 {
|
||||||
|
device_type = "cpu";
|
||||||
|
compatible = "qcom,kryo385";
|
||||||
|
reg = <0x0 0x700>;
|
||||||
|
enable-method = "psci";
|
||||||
|
next-level-cache = <&L2_700>;
|
||||||
|
qcom,freq-domain = <&cpufreq_hw 1>;
|
||||||
|
L2_700: l2-cache {
|
||||||
|
compatible = "cache";
|
||||||
|
next-level-cache = <&L3_0>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
};
|
||||||
|
|
||||||
|
soc {
|
||||||
|
#address-cells = <1>;
|
||||||
|
#size-cells = <1>;
|
||||||
|
|
||||||
|
cpufreq@17d43000 {
|
||||||
|
compatible = "qcom,cpufreq-hw";
|
||||||
|
reg = <0x17d43000 0x1400>, <0x17d45800 0x1400>;
|
||||||
|
reg-names = "freq-domain0", "freq-domain1";
|
||||||
|
|
||||||
|
clocks = <&rpmhcc RPMH_CXO_CLK>, <&gcc GPLL0>;
|
||||||
|
clock-names = "xo", "alternate";
|
||||||
|
|
||||||
|
#freq-domain-cells = <1>;
|
||||||
|
};
|
||||||
|
};
|
||||||
|
...
|
||||||
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